5、较强的处理实际技术问题的能力、工程能力与学术能力。

　　前端设计高级工程师2数字集成电路博士学历，具有三年以上芯片前端研发经验，具有2个芯片以上的tapeout经验1.熟悉整个ASIC设计流程,熟练使用Debussy.DC.VCS.PT等EDA工具;

　　2.掌握Verilog-HDL语言，具备把抽象的设计转化为实际电路的ASIC设计能力熟练使用TCL编写综合脚本，DesignCompiler产生网表，并使用PT分析时序;

　　3.能熟练使用VCS或NC-verilog进行功能.网表.时序仿真;

　　4.熟悉数字信号处理，具有搭建小型系统的能力;

　　5.熟悉通信、网络协议，并有光纤通信研发经验者优先;

　　6.熟悉UNIX.Solaris操作系统;

　　7.具有良好的沟通能力以及团队合作精神。

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